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模擬 IP 創(chuàng)新者 Agile Analog 現(xiàn)在提供了一整套 IoT 設計所需的關鍵模擬 IP。它們分為六個模塊，圍繞客戶對處理器內核和內存的選擇，提供處理器數(shù)字世界與模擬現(xiàn)實世界之間接口所需的所有重要模擬功能。  

Agile Analog 的首席執(zhí)行官 Barry Paterson 解釋說：“我們將這些稱為我們的基礎 IP，因為它們提供了物聯(lián)網(wǎng)設計所需的所有功能。客戶可以混合和匹配他們設計所需的任何模塊，并調整其中每個 IP 的數(shù)量。”  

例如，電源模塊可以包含多個agile LDO，以提供必要的內部電壓軌以及agilePOR，以確保SoC 僅在存在穩(wěn)定的電壓軌時啟動。 IC 健康和監(jiān)控模塊使用agileTsense 監(jiān)控SoC 芯片溫度，而agileIR DROP 監(jiān)控長期老化效應。  

確保 SoC 的安全是當今的一個關鍵問題，因此安全保護模塊使用agileVGlitch 和agileTsense 來監(jiān)控使用電壓和溫度操縱的攻擊向量。 客戶可能不需要無線電接口，但如果他們需要，無線電接口可以支持他們需要的任何一個，例如低功耗藍牙或 LoRa。  

“實際上，這為設計可能需要的所有模擬部件提供了一個基礎工具包，以快速跟蹤、簡化和重新冒險設計過程，” Barry Paterson補充道。 “我們提供了客戶所需的所有特性和功能，這樣客戶可以從套裝中準確選擇他們需要的IP，而不必擔心他們錯過了一些重要的細節(jié)。  

“重要的是，我們提供的高水平客戶支持確保了輕松和完美的集成，這與一些只銷售模擬模塊并讓客戶弄清楚如何使用它們的競爭對手不同。 此外，客戶可以放心地知道，通過使用來自一家供應商的 IP，我們所有的 IP 塊都經(jīng)過了全面測試，可與我們的所有其他塊兼容。”  

Agile Analog 產(chǎn)品的一個關鍵特性是它在設計階段得到公司的全力支持，以確保它滿足設計的功率、性能和面積要求。 這還包括支持將 IP 集成到整體設計中。塊內的 IP 在內部互連并且塊具有外部接口，因此它們看起來像數(shù)字塊并且可以進入數(shù)字設計流程，從而使這變得更容易。  

Agile Analog 的創(chuàng)新 Composa 技術能夠針對客戶需要的任何流程和節(jié)點生成和驗證這些模塊。 如果這種變化能夠在代工廠和流程之間實現(xiàn)輕松移植，它可以快速重新生成解決方案。

支持所有主要代工廠，包括臺積電、GlobalFoundries、三星代工廠和中芯國際以及其他 IC 代工廠和制造商。  

這六個模塊分別為：  

· 帶有Voltage Glitch Sensor 和Temperature Sensor的SoC/ASIC 安全保護。

· 帶有 8/10 位 SAR ADC、8/10 位 DAC 和低功耗可編程比較器的傳感器接口

· Always on Block 具有低功耗 RC Oscillator、Low Power Bandgap、Compact Digital Standard Cell Library、Low Power Programmable Comparator和Power on Reset。

· 帶有Temperature Sensor和IR Drop Sensor 的IC Health and Monitoring。

· 具有Low Dropout Regulator、Power on Reset、IR Drop Sensor和Low Power Bandgap。

· 帶有8/10 位SAR ADC、8/10 位DAC、RC Oscillator和Low Dropout Regulator的Radio Interface。

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